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PIC16C745/765
DS41124C-page 88
Preliminary
2000 Microchip Technology Inc.
FIGURE 11-8: SYNCHRONOUS RECEPTION (MASTER MODE, SREN)
CREN bit
RC7/RX/DT pin
RC6/TX/CK pin
Write to
bit SREN
SREN bit
RCIF bit
(interrupt)
Read
RXREG
Note: Timing diagram demonstrates Sync Master mode with bit SREN = ’1’ and bit BRG = ’0’.
Q3 Q4 Q1 Q2 Q3 Q4 Q1 Q2 Q3 Q4
Q2
Q1 Q2 Q3 Q4Q1 Q2 Q3 Q4 Q1 Q2 Q3 Q4Q1 Q2 Q3 Q4 Q1 Q2 Q3 Q4Q1 Q2 Q3 Q4 Q1 Q2 Q3 Q4
’0’
bit0
bit1
bit2
bit3
bit4
bit5
bit6
bit7
’0’
Q1 Q2 Q3 Q4
745cov.book Page 88 Wednesday, August 2, 2000 8:24 AM
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